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동영상 전화기용 다중 스레드 비디오 코딩 프로세서
Multithread video coding processor for the videophone

김정민    (서울대학교 반도체공동연구소 및 전자공학과   ); 홍석균    (서울대학교 반도체공동연구소 및 전자공학과   ); 이일완    (서울대학교 반도체공동연구소 및 전자공학과   ); 채수익    (서울대학교 반도체공동연구소 및 전자공학과  );
  • 초록

    The architecture of a programmable video codec IC is described that employs multiple vector processors in a single chip. The vector processors operate in parallel and communicate with one another through on-chip shared memories. A single scalar control processor schedules each vector processor independently to achieve real-tiem video coding with special vector instructions. With programmable interconnection buses, the proposed architecture performs multi-processing of tasks and data in video coding. Therefore, it can provide good parallelism as well as good programmability. especially, it can operate multithread video coding, which processes several independent image sequences simultaneously. We explain its scheduling, multithred video coding, and vector processor architectures. We implemented a prototype video codec with a 0.8um CMOS cell-based technology for the multi-standard videophone. This codec can execute video encoding and decoding simultaneously for the QCIF image at a frame rate of 30Hz.


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  • 이일완 (2)

    1. 1994 "확률 연산을 이용한 볼츠만 머신" 電子工學會論文誌. Jounnal of the Korea institute of telematics and electronics. A. A a31 (6): 159~168    
    2. 1997 "거리 근사를 이용하는 고속 최근 이웃 탐색 분류기에 관한 연구" 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C c34 (2): 71~79    
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