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디지털 제어 적분형의 차단 현상이 없는 A/D 다중 비트 $\Sigma\Delta$ 변조기
A Clipping-free Multi-bit $\Sigma\Delta$ Modulator with Digital-controlled Analog Integrators

이동연    (서울대학교 전기공학과   ); 김원찬    (서울대학교 전기공학과  );
  • 초록

    This paper proposes a multi-bit $\Sigma\Delta$ modulator arcitecture which eliminates signal clipping problem. To avoid signal clipping, the output values of intgrators are monitored and modified by a reference value. This oepration is recorded as a digital code to restore actual signal value. Due to the digital code, the substraction of feedback value from the multi-bit quantizer can be calculated by a digital adder and this simplifies dAC operation making the accurate DAC of conventional multi-bit $\Sigma\Delta$ modulator scheme unnecessary. These features make N-th modulator can be implemented by sharing an integrator among N stages to decrease the required chip area. As an experimental example, a 4th order .sum..DELTA. modulator with oversampling ratio of 64 was simulated to show over 130 DB SNR at rail-to-rail input sinusoidal signal.


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    9. 1997 "CMOS 공정을 이용한 15MHz, 2.6mW, 6차 대역통과 Gm-C 필터" 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C c34 (6): 51~57    
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