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새로운 수리형태학 필터 VLSI 구조 설계
Design of a new VLSI architecture for morphological filters

웅수환    (아주대학교 공과대학 전기전자공학부   ); 선우명훈    (아주대학교 공과대학 전기전자공학부  );
  • 초록

    This paper proposes a new VLSI architecture for morphological filters and presents its chip design and implementation. The proposed architecture can significantly reduce hardware costs compared with existing architecture by using a feedback loop path to reuse partial results and a decoder/encoder pair to detect maximum/minimum values. In addition, the proposed architecture requires one common architecture for both diltion and erosion and fewer number of operations. Moreover, it can be easily extended for larger size morphologica operations. We developed VHDL (VHSIC hardware description language) models, performed logic synthesis using the SYNOPSYS CAD tool. We used the SOG (sea-of-gate) cell library and implemented the actual chip. The total number of gates is only 2,667 and the clock frequency is 30 MHz that meets real-time image processing requirements.


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    2. 1994 "형태론적 고속 복원성 여파기" 電子工學會論文誌. Journal of the Korea institute of telematics and electronics. B b31 (12): 81~90    
    3. 1995 "LPC 분석 알고리즘의 VHDL 구현" 電子工學會論文誌. Journal of the Korea institute of telematics and electronics. B b32 (1): 96~102    
    4. 1996 "SliM 이미지 프로세서 칩 설계 및 구현" 電子工學會論文誌. Jounnal of the Korea institute of telematics and electronics. A. A a33 (10): 186~194    
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    6. 1997 "멀티채널 TV 시스템에서 주화면과 부화면간의 동기화를 위한 ASIC 칩 설계" 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C c34 (2): 19~28    
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    10. 1998 "휴대 멀티미디어 응용을 위한 DSP 칩 설계 및 구현" 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C c35 (12): 31~39    

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