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Reed-Muller 전개식에 의한 범용 논리 모듈 U$_{f}$ 의 다치 논리 회로의 최적 합성에 관한 연구
A Study on Optimal Synthesis of Multiple-Valued Logic Circuits using Universal Logic Modules U$_{f}$ based on Reed-Muller Expansions

최재석    (인하대학교 전자공학과   ); 한영환    (상지대학교 전산학과   ); 성현경    (상지대학교 전산학과  );
  • 초록

    In this paper, the optimal synthesis algorithm of multiple-valued logic circuits using universal logic modules (ULM) U $_{f}$ based on 3-variable ternary reed-muller expansions is presented. We check the degree of each varable for the coefficients of reed-muller expansions and determine the order of optimal control input variables that minimize the number of ULM U $_{f}$ modules. The order of optimal control input variables is utilized the realization of multiple-valued logic circuits to be constructed by ULM U $_{f}$ modules based on reed-muller expansions using the circuit cost matrix. This algorithm is performed only unit time in order to search for the optimal control input variables. Also, this algorithm is able to be programmed by computer and the run time on programming is O(p $^{n}$ ).


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    1. 1994 "전류방식 CMOS에 의한 ROM 형의 다치 논리 회로 설계" 電子工學會論文誌. Journal of the Korea institute of telematics and electronics. B b31 (4): 55~61    
    2. 1997 "에지값 결정도(決定圖)에 의한 다치논리함수구성(多値論理函數構成)에 관한 연구(硏究)" 전기전자학회논문지 = Journal of IKEEE 1 (1): 111~119    
    3. 1998 "코드할당에 의한 다치논리함수의 모듈러 함수분해에 관한 연구" 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C c35 (7): 78~91    
    4. 1998 "에지값 결정도에 의한 다치논리함수구성과 전가계기설계에 관한 연구" 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C c35 (3): 69~78    
    5. 1998 "DCG에 의한 고속병렬다치논리회로설계에 관한 연구" 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C c35 (6): 20~29    
  • 한영환 (24)

  • 성현경 (41)

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